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    成都:4008699035 武漢:027-50767718
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      Xilinx專業培訓課程

            培訓結束后頒發工程師培訓證書。

       班.級.規.模.及.環.境

            為了保證培訓效果,增加互動環節,我們堅持小班授課,每期報名人數限3到5人。人手一機,全程實踐。

       上課時間和地點

              上課地點:【【上!浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道)
              本課程每期班限額5名,報滿即停止報名,請提前在線或電話預約

       課時
            ◆課時:咨詢在線客服
            ◆團體報名優惠措施:兩人95折優惠,三人或三人以上9折優惠 。注意:在讀學生憑學生證,即使一個人也優惠500元。
            
            ☆注重質量
            ☆邊講邊練

            ☆合格學員免費推薦工作


            專注高端培訓17年,曙海提供的課程得到本行業的廣泛認可,學員的能力
            得到大家的認同,受到用人單位的廣泛贊譽。

            ★實驗設備請點擊這兒查看★
       .質.量.保.障.

            1、培訓過程中,如有部分內容理解不透或消化不好,可免費在下期培訓班中重聽;
            2、培訓結束后免費提供半年的技術支持,充分保證培訓后出效果;
            3、培訓合格學員可享受免費推薦就業機會。

       .課.程.大.綱.
            全部授課內容均在計算機和實驗器材上實際操作。 周末班、連續班、晚班任選

    Xilinx專業培訓課程

     

    序號

    最近開課時

    芯片、集成電路設計系列培訓班

    F1

    Design for Performance

    Design for Performance

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F2

    Advance FPGA Implementation

    Advance FPGA Implementation

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F3

    Embedded System Design

    Embedded System Design

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F4

    AdvancedFeaturesandTechniquesofEmbedded Systems

    AdvancedFeaturesandTechniquesofEmbedded Systems

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F5

    Design LogiCORE PCI System

    Design LogiCORE PCI System

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F6

    Design LogiCORE PCIX System

    Design LogiCORE PCIX System

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F7

    Design LogiCORE PCI Express System

    Design LogiCORE PCI Express System

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F8

    DSP Implementation Techniques in Xilinx FPGAs

    DSP Implementation Techniques in Xilinx FPGAs

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F9

    Fundamental FPGA Design

    Fundamental FPGA Design

    2021年9月6日(請抓緊報名)

    5天;
    30學時

    F10
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F11
    Signal Integrity for High-Speed Memory and Processor I/O
    Signal Integrity for High-Speed Memory and Processor I/O
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F12
    Designing with Multi-Gigabit Serial I/O Designing with Multi-Gigabit Serial I/O
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F13
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F14
    ISE 設計入門
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F15
    Design with Virtex4
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F16
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F17
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F18
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F19
    Using System Generator for DSP Design
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F20
    Design with Xilinx Gigabit Ethernet MAC Design with Xilinx Gigabit Ethernet MAC
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F21
    Introduction to AccelDSP
    2021年9月6日(請抓緊報名)
    5天;
    30學時
    F22
    Designing with Spartan-6 and Virtex-6 Families Designing with Spartan-6 and Virtex-6 Families
    2021年9月6日(請抓緊報名)
    5天;
    30學時